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- Patterson and Hennessy 学习笔记 #1 —— Chapter 1 Computer Abstractions and Technology
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- 学习 Vim 之《Pratical Vim》读书笔记
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- Python 学习笔记 #10 —— Python 中的 FP
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- Python 学习笔记 #9 —— Function Arguments 函数参数
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- Python 学习笔记 #8 —— Decorator 装饰器
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- Python 学习笔记 #7 —— Generator 生成器
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- Python 学习笔记 #6 —— Iterator 迭代器
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- Git Flow 小结
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- Python 学习笔记 #5 —— Comprehension 解析式
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- Python 学习笔记 #3 —— Docstring 风格
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- Python 学习笔记 #2 —— PEP8 实践
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- Python 学习笔记 #1 —— PEP8 编程风格
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- Python 学习笔记 #0 —— 新的开始
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- FIFO 设计笔记
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- 数字信号处理中的各种频率
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- 低功耗设计
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- 流水线 pipeline 的艺术
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- 学习 Vim 之 vim_signature 插件
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- 学习 Vim 之 lookupfile 插件
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- Regular Expression 小结
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- Verilog HDL coding style
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- Verilog 项目配置
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- 时钟生成
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- 可配置设计
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- Verilog 的 case 小结
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- 不想当司机的厨子不是好码农 —— 读《浪潮之巅》
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- 静态时序分析 STA 2 —— Xilinx STA
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- 静态时序分析 STA 1 —— 基础知识
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- 相关系数及Matlab函数
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- 关于冒险和毛刺
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- OFDM 中的 IFFT/FFT 注意事项
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- 信噪比小结
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- 学习 Vim 之 BufExplorer、NERDTree、WinManager、Powerline 插件
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- 活着 有感
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- 在 Vim 中写 Markdown 文件
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- 学习 Vim 之 Ctags/Cscope/Taglist
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- 针对 Verilog 的 Doxygen
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- 利用 Graphviz 画 FSM 状态图
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- 基于 Doxygen 的 C++ 注释风格
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- 学习 Vim 插件 DoxygenToolKit.vim
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- 如何优雅的分析代码
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- LTE 咬尾卷积编码器的 Matlab 、C 语言及 FPGA 实现
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- FPGA 中的延时
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- 计数器设计小结
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- 番茄工作法 总结 + 实践
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- GTD 书评 + 总结
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- 时钟分频器
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- FPGA 时钟设计 3 —— 跨时钟域设计
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- 锁存器 Latch v.s. 触发器 Flip-Flop
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- VHDL 笔记 2 —— 系统设计
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- 数字信号处理和相关matlab函数总结
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- Xilinx FFT IP core 笔记
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- FPGA 时钟设计 1 —— 时钟资源总结
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- Verilog 中的参数化建模
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- FPGA 数字处理基础 (2)
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- Sublime Text 2 和 Verilog HDL
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